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Chipnation 2024 IMSE
CHIPNATION 2024: IMSE explora las oportunidades y desafíos de la tecnología neuromórfica

El catedrático de Investigación del IMSE, Bernabé Linares-Barranco, participó como panelista en CHIPNATION 2024, el congreso sobre microelectrónica organizado por la Asociación Española de la Industria de Semiconductores – AESEMI, los días 2 y 3 de diciembre de 2024 en Valencia.
12 Diciembre 2024

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Aplicacion Buscanidos IMSE
Buscanidos: juega y contribuye a la conservación del Chorlitejo Patinegro

Desde el mes de octubre, el Museo Casa de la Ciencia de Sevilla acoge la innovadora aplicación interactiva Buscanidos, desarrollada por el investigador del Instituto de Microelectrónica de Sevilla (IMSE-CNM) Gustavo Liñán-Cembrano.
4 Diciembre 2024

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Taller MathWorks 2024
MathWorks impulsa el modelado y el diseño avanzado en el IMSE

Técnicos de MathWorks, corporación estadounidense especializada en software de informática matemática, han visitado el IMSE para ofrecer talleres teórico-prácticos sobre MATLAB.
2 Diciembre 2024

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Science Wonderful 2024
El IMSE estará por segundo año consecutivo en la feria de la ciencia de la Comisión Europea

"Science is Wonderful!", la feria internacional de la ciencia organizada por la Comisión Europea, se celebrará en Bruselas los próximos 12, 13 y 14 de marzo de 2025, y volverá a contar por segundo año consecutivo con la participación de un equipo de investigadores del Instituto de Microelectrónica de Sevilla (IMSE-CNM).
12 Noviembre 2024

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IMEC visita el IMSE
IMEC visita el IMSE para explorar oportunidades de colaboración tras su llegada a España

La visita consistió en una primera ronda de presentación de las distintas entidades y un posterior recorrido por los laboratorios del centro.
28 Octubre 2024

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El futuro de las PUFs
Resistentes a los cambios de temperatura: así será el futuro de las PUFs

Desde el Instituto de Microelectrónica de Sevilla (IMSE-CNM) nos complace anunciar la reciente publicación de la mano de la revista IEEE Transactions on Circuits and Systems I: Regular Papers del artículo titulado "A Comprehensive Approach to Improving the Thermal Reliability of RTN-Based PUFs" al que han contribuido investigadores de nuestro centro.
8 Octubre 2024

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EVENTOS Y NOTICIAS ANTERIORES

Nueva Directora del IMSE-CNM


La investigadora del IMSE Teresa Serrano Gotarredona ha sido nombrada nueva Directora del Instituto de Microelectrónica de Sevilla.

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Exploiting the acousto-optic effect for developing secure digital identifiers
D. Martín-Sánchez and P. Brox
Conference · Moscone South, Room 302 (Level 3), San Francisco, Estados Unidos, 28 Enero 2025
resumen     

Cybersecurity is rooted in hardware to achieve high security. Physical unclonable functions (PUFs) are cryptographic primitives that implement one-way functions to generate cryptographic keys on-demand. Current approaches implement PUFs using microelectronic circuits that exploit the random manufacturing variabilities. Other alternatives exploit optical principles to offer higher security. However, their reliability is compromised by environmental effects and integrated systems are still to be realized. Here a novel approach is proposed to enhance reliability and potentially enable integration in digital security systems. The proposed method uses the acousto-optical effect to interrogate optical PUFs, avoiding precision alignment of moving parts and bulky equipment. This way of interrogating the PUF can also be miniaturized in a photonic integrated circuit. The experimental results demonstrate the feasibility of this approach and the potential for generating a large number of truly random cryptographic keys.

Open Source API for a Hardware Root-of-Trust
E. Camacho-Ruiz, L.F. Rojas-Muñoz, A. Karmakar, P. Navarro-Torrero, P. Brox and M.C. Martínez-Rodríguez
Conference · XVIII Reunión Española de Criptología y Seguridad de la Información, 23-25 octubre 2024, León (España)
resumen     

This paper presents an API designed for a hardware-based Root of Trust that provides a suite of essential cryptographic and security functions based on hardware cryptographic IP cores. The high-level abstraction of the API enables software developers to create secure applications within secure computing systems by leveraging the benefits of hardware IP cores. The hardware IP cores that support the API are compliant with international standards, ensuring robust security and reliability. The API development adheres to the open-source science policies and is published online under a public license. Additionally, the portability of the API across multiple platforms ensures wide compatibility and accessibility, enabling seamless integration and reproducibility.

Design of a Karatsuba Multiplier to Accelerate Digital Signature Schemes on Embedded Systems
P. Navarro-Torrero, E. Camacho-Ruiz, M.C. Martínez-Rodríguez and P. Brox
Conference · IEEE Nordic Circuits and Systems Conference (NorCAS), 2024
resumen      doi      

This paper presents the design and implementation of a Karatsuba multiplier to accelerate digital signature schemes on embedded systems. The Karatsuba algorithm is integrated into hardware accelerators for RSA and EdDSA, representing a fundamental component of contemporary, state-of-the-art implementations. A hardware/software co-design methodology is employed, implementing the architectures on a System-onChip platform that combines programmable logic with an ARM processor. The results showcase enhanced resource consumption and timing performance for both signature generation and verification, confirming the superiority of EdDSA over RSA when utilizing the same Karatsuba multiplier core and coding techniques.

VLSI integration of a RO-based PUF into a 65 nm technology
P. Ortega-Castro, L.F. Rojas-Muñoz, J.M. Mora-Gutiérrez, P. Brox and M.C. Martínez-Rodríguez
Conference · IEEE Nordic Circuits and Systems Conference (NorCAS), 2024
resumen      doi      

Ring Oscillator Physical Unclonable Functions (ROPUFs) take advantage of process variability during the manufacturing process to exploit the small differences in the RO oscillating frequencies and generate unique identifiers (ID). Its structure makes it suitable for, both, FPGA and ASIC applications. This paper presents a RO-PUF implementation using a semi-custom design methodology in TSMC 65 nm technology which has been validated through the entire design process, manufactured and experimentally characterized. Results show a good performance and robustness against temperature and voltage variations while obtaining up to three bits from each execution to generate digital IDs.

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El área de especialización del Instituto es el diseño de circuitos integrados analógicos y de señal mixta en tecnología CMOS, así como su uso en diferentes contextos de aplicación tales como dispositivos biomédicos, comunicaciones inalámbricas, conversión de datos, sensores de visión inteligentes, ciberseguridad, computación neuromórfica y tecnología espacial.

La plantilla del IMSE-CNM está formada por unas cien personas, entre personal científico y de apoyo, que participan en el avance del conocimiento, la generación de diseños de alto nivel científico-técnico y la transferencia de tecnología.

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