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Dataset EDB Digital CSIC
Un investigador del IMSE entre los autores de uno de los mayores datasets de Digital CSIC

Gustavo Liñán-Cembrano, investigador del IMSE, figura como principal investigador y ha sido el responsable de la parte tecnológica de un dataset con cerca de un millón de imágenes.
10 Julio 2024

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Curso Verano UIMP
Abierto el plazo de matriculación para el curso de verano de la UIMP "Los datos en investigación: retos y oportunidades"

La formación tendrá lugar los días 26, 27 y 28 de agosto en la Península de la Magdalena, Santander.
5 Julio 2024

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Visita Danilo Demarchi
Danilo Demarchi visita el IMSE para tratar la innovación en los sistemas agroalimentarios

El profesor italiano ofreció un coloquio acerca de la modernización de los eslabones de la cadena alimentaria, haciendo especial hincapié en el papel de la Inteligencia Artificial.
1 Julio 2024

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Workshop Red DEDOSS
El IMSE, presente en el workshop de la Red DEDOSS en Cáceres

El evento reunió a investigadores de diferentes Escuelas y Universidades, que intercambiaron ideas y propuestas sobre el uso de ordenadores en diferentes campos de investigación.
27 Junio 2024

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IMSE premio ASPIRA MaX
El IMSE, galardonado con el distintivo de excelencia ASPIRA MaX CSIC

En esta ocasión, se otorgaron 40 nuevos distintivos Josefa Barba a los Institutos y Centros (ICUs) del CSIC, entre los cuales se incluyó al Instituto de Microelectrónica de Sevilla (IMSE-CNM).
14 Junio 2024

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Seminario Jose Manuel de la Rosa
El Centro Nacional de Investigaciones Metalúrgicas habla de Microelectrónica

El investigador del Instituto de Microelectrónica de Sevilla (IMSE-CNM), José Manuel de la Rosa, abordó el tema "Del Transistor a la Radio Cognitiva" en el sexto seminario dentro de la 1ª Edición del Ciclo de Seminarios de divulgación científica CENIM-DIVULGA.
13 Junio 2024

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EVENTOS Y NOTICIAS ANTERIORES

Nueva Directora del IMSE-CNM


La investigadora del IMSE Teresa Serrano Gotarredona ha sido nombrada nueva Directora del Instituto de Microelectrónica de Sevilla.

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Exploiting randomly distributed pores in photonic structures for security applications to create hardware-based digital identity
D. Martín-Sánchez and P. Brox
Conference · NanoSpain Conf 2024, Tarragona, España
resumen     

In the 2024 edition, the conference will strength collaborations with the COST network Netpore in the field of porous semiconductors and oxides. The intersection of nanoSpain2024 and the thematic network COST will encourage collaborative dialogues and the initiation of potential partnerships between researchers and industry professionals. More info at https://www.nanospainconf.org/2024

A CMOS-compatible oscillation-based VO2 Ising machine solver
O. Maher, M. Jiménez, C. Delacour, N. Harnack, J. Núñez, M.J. Avedillo, B. Linares-Barranco, A. Todri-Sanial, G. Indiveri and S. Karg
Journal Paper · Nature Communications vol. 15, article 3334, 2024
NATURE    ISSN: 2041-1723
resumen      doi      

Phase-encoded oscillating neural networks offer compelling advantages over metal-oxide-semiconductor-based technology for tackling complex optimization problems, with promising potential for ultralow power consumption and exceptionally rapid computational performance. In this work, we investigate the ability of these networks to solve optimization problems belonging to the nondeterministic polynomial time complexity class using nanoscale vanadium-dioxide-based oscillators integrated onto a Silicon platform. Specifically, we demonstrate how the dynamic behavior of coupled vanadium dioxide devices can effectively solve combinatorial optimization problems, including Graph Coloring, Max-cut, and Max-3SAT problems. The electrical mappings of these problems are derived from the equivalent Ising Hamiltonian formulation to design circuits with up to nine crossbar vanadium dioxide oscillators. Using sub-harmonic injection locking techniques, we binarize the solution space provided by the oscillators and demonstrate that graphs with high connection density (μ > 0.4) converge more easily towards the optimal solution due to the small spectral radius of the problema’s equivalent adjacency matrix. Our findings indicate that these systems achieve stability within 25 oscillation cycles and exhibit power efficiency and potential for scaling that surpasses available commercial options and other technologies under study. These results pave the way for accelerated parallel computing enabled by large-scale networks of interconnected oscillators.

Cryptographic Security Through a Hardware Root of Trust
L.F. Rojas-Muñoz, S. Sánchez-Solano, M.C. Martínez-Rodríguez, E. Camacho-Ruiz, P. Navarro-Torrero, A. Karmakar, C. Fernández-García, E. Tena-Sánchez, F.E. Potestad-Ordóñez, A. Casado-Galán, P. Ortega-Castro, A.J. Acosta-Jiménez, C.J. Jiménez-Fernández and P. Brox
Conference · Applied Reconfigurable Computing. Architectures, Tools, and Applications (ARC), 2024
resumen      doi      

This work presents a novel approach to a Hardware Root-of-Trust that leverages System-on-Chip technology for the implementation of hardware cryptographic functions. Taking advantage of the processing power of a System-on-Chip, the solution established promotes hardware-based security solutions over software-only solutions. The proposed Root-of-Trust, developed around a Xilinx Zynq-7000 SoC device, integrates components based on cryptographic algorithms and physical phenomena. This innovative Root-of-Trust is tailored to support a spectrum of security tasks within cryptographic systems, including device-specific identifiers and keys, encryption and decryption, hashing, and signature generation and verification. The study adopts a unified design methodology, capitalizing on collaborative efforts to efficiently develop hardware primitives that significantly contribute to enhancing security in computing environments. Aligned with the advantages of reconfigurable hardware, this Hardware Root-of-Trust addresses the critical need for robust hardware-level security and introduces a set of countermeasures to fortify the design against potential threats.

A Small-Area 2nd-Order Adder-Less Continuous-Time ΔΣ Modulator With Pulse Shaping FIR DAC for Magnetic Sensing
M. Srivastava, A. Ferro, A. Sidun, P. Cantillon-Murphy, Daniel O’Hare, K. O’Donoghue and J.M. de la Rosa
Journal Paper · IEEE Open Journal of Circuits and Systems (Volume 5), 2024
IEEE    ISSN: 2644-1225
resumen      doi      

This work presents a small-area 2nd-order continuous-time ΔΣ Modulator (CTΔΣM) with a single low dropout regulator (LDO) serving as both the power supply for the CTΔΣM and reference voltage buffer. The CTΔΣM is used for digitising very low amplitude signals in applications such as magnetic tracking for image-guided and robotic surgery. A cascade of integrators in a feed-forward architecture implemented with an adder-less architecture has been proposed to minimise the silicon area. In addition, a novel continuous-time pulse-shaped digital-to-analog converter (CT-PS DAC) is proposed for excess loop delay (ELD) compensation to simplify the current drive requirements of the reference voltage buffer. This enables a single low-dropout (LDO) voltage regulator to generate both power supply and Vref for the DAC. The circuit has been designed in 65-nm CMOS technology, achieving a peak 82-dB SNDR and 91-dB DR within a signal bandwidth of 20 kHz and the CTΔΣM consumes 300 μW of power when clocked at 10.24 MHz. The CTΔΣM achieves a state-of-the-art area of 0.07 mm.

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El área de especialización del Instituto es el diseño de circuitos integrados analógicos y de señal mixta en tecnología CMOS, así como su uso en diferentes contextos de aplicación tales como dispositivos biomédicos, comunicaciones inalámbricas, conversión de datos, sensores de visión inteligentes, ciberseguridad, computación neuromórfica y tecnología espacial.

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